江蘇萊特北斗信息科技有限公司
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訪問次數(shù):550更新時(shí)間:2021-10-18 14:28:03
1、GNSS接收機(jī)開發(fā)平臺(tái)(LT20099)簡單介紹
GNSS接收機(jī)開發(fā)平臺(tái)采用ARM處理器+FPGA+射頻模塊的架構(gòu),適用于衛(wèi)星導(dǎo)航基帶信號(hào)處理和定位解算系統(tǒng)的設(shè)計(jì)開發(fā)??芍С直倍稡1、GPS L1、GLONASS L1、Galileo E1頻點(diǎn)接收機(jī)的設(shè)計(jì)開發(fā),升級(jí)型平臺(tái)可支持925MHz~2175MHz信號(hào)處理,可覆蓋全頻段的GNSS信號(hào)。
GNSS接收機(jī)開發(fā)平臺(tái)基于GNSS衛(wèi)星導(dǎo)航教學(xué)而研發(fā),將衛(wèi)星導(dǎo)航信號(hào)處理流程分解到不同實(shí)驗(yàn)中,并采用射頻、基帶信號(hào)處理、定位解算三部分分離的軟硬件平臺(tái),使學(xué)生能通過該平臺(tái)快速了解和掌握衛(wèi)星導(dǎo)航的基本原理及接收機(jī)的基本框架。
此外,F(xiàn)PGA+ARM架構(gòu)使該平臺(tái)擁有很好的擴(kuò)展性能,適合EDA實(shí)驗(yàn)及課程設(shè)計(jì)、各類數(shù)字信號(hào)處理、工業(yè)控制等不同應(yīng)用。
2、GNSS接收機(jī)開發(fā)平臺(tái)性能指標(biāo):
ARM核心板:以STM32F205ZE處理器為核心,擁有兩路RS232電平串口和兩路TTL電平串口輸出;
FPGA核心板:FPGA芯片采用Altera公司CycloneIII系列的EP3C55F484,核心板預(yù)留120個(gè)通用I/O引腳和16個(gè)全局時(shí)鐘引腳;
射頻板:以MAX2769為核心器件,均預(yù)留SPI配置接口,雙射頻板兩路信號(hào)獨(dú)立,可配置成北斗B1、GPS L1、GLONASS L1、Galileo E1等頻點(diǎn)。